lunes, 20 de abril de 2009
miércoles, 15 de abril de 2009
Display de 7 segmentos
Quizás la mas utilizada sea la de 7 LED’s colocados en forma de ocho tal y como se indica en la figura. Aunque externamente su forma difiere considerablemente de un diodo LED típico, internamente están constituidos por una serie de diodos LED con unas determinadas conexiones internas. En la figura se indica el esquema eléctrico de las conexiones del interior de un indicador luminoso de 7 segmentos..................
Cátodo común va conectado a tierra y ánodo común va a Vcc. Contiene siete LED rectangulares (a - g), en el que cada uno recibe el nombre de segmento porque forma parte del símbolo que esta mostrando. Con un indicador de siete segmentos se pueden formar los dígitos del 0 al 9, también las letras a, c, e y f y las letras minúsculas b y d. Polarizando los diferentes diodos, se iluminaran los segmentos correspondientes. Cada segmento (y el punto) es un led como cualquier otro, debido a esto la corriente media que se debe aplicar es de 15 mA. Dependiendo de la lógica que estemos empleando debemos utilizar una resistencia por cada entrada y así no forzar el dispositivo:
Lógica TTL (5V): 220 ohmios
Lógica CMOS (12V): 680 ohmios. Esta resistencia debe ser situada en cada patilla, haciendo de puente entre la señal lógica de excitación y el Display.

Sitios relacionados con el tema: Unicrom, Monografias, Documento de Cypsela, Electronguia
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Números Binarios
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Contador de décadas Asíncrono
Entonces, un módulo tipico en los contadores con secuencia truncada es de diez, tambien conocido como MOD10. Los contadores que tienen diez estados en su secuencia se denominan contadores de decadas; cuya secuencia va de cero (0000) a nueve (1001), por lo tanto es un contador de décadas BCD, ya que su secuencia de diez estados corresponde al codigo BCD. Este tipo de contador resulta de gran utilidad en aplicaciones de gran variedad.
Algo muy importante que debemos de tomar en cuenta es que para obtener una secuencia truncada, es necesario forzar al contador a que inicie un nuevo ciclo antes de haber pasado por todos los estados normales. Este contador tiene que comenzar de nuevo en el estado 0000 después de pasar por el estado 1001.
lo que significaria que se necesitarian 4 flip-flops para que den 16 estados. Pero recordemos que cuando pase del estado 9 (1001) tiene que reiniciar a 0000, por lo tanto cuando llegue el estado 10 (1010) reinicia, para eso usaremos una compuerta AND como se ve en el diagrama, a esto se le conoce como decodificación parcial, ya que únicamente Q1 y Q3 estan conectadas a las entradas de la compuerta NAND, ya que son necesarios solo dos estados Q(U1:B)=1 y Q(U2:B)=1 para decodificar el valor diez, ya que ninguno de los otros estados tienen Q(U1:B) y Q(U2:B) a nivel ALTO al mismo tiempo. Cuando el contador llega al número diez (1010), la salida de la compuerta decodificadora pasa a nivel BAJO y pone a cero asíncronamente todos los flip-flops. El Flip-Flop que utilizaremos será el 74LS73 con un decodificador 74LS47 con display anodo común.





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Contador Asíncrono de 3 Bits
(vease Contador Asíncrono)
La secuencia de estados de un contador binario de 3 bits se presenta en la siguiente tabla y en el siguiente diagrama:
Como podrán ver se muestra un contador asíncrono binario de 3 bits, su funcionamiento basico es el mismo que el del contador de 2 bits, excepto en que el contador de 3 bits tiene ocho estados, ya que esta formado por tres flip-flops. En el siguiente diagrama animado pueden ver el funcionamiento:
Al ver el funcionamiento podemos observar que avanza a través de una secuencia binaria dede cero hasta siete, iniciando despues un nuevo ciclo desde su estado cero. Este contador puede ampliarse fácilmente a un contador mayor, concectando flip-flops adicionales.
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Contador Asíncrono
Contador Asíncrono binario de 2 bits
La siguiente simulacion presenta un contador de 2 bits conectado para que funcione en modo asíncrono. Observe que el reloj CLK esta conectado únicamente a la entrada de reloj del primer flip-flop, IC1a, el segundo flip-flop, IC1b, se dispara mediante la salida Q de IC1a. IC1a cambia de estado durante el flanco negativo de cada impulso de reloj, pero IC1b solo cambia cuando es disparado por una transicion negativa de la salida Q de IC1a. Debido al retardo de propagación inherente al paso de las señales por un flip-flop, las transiciones de los impulsos de entrada del reloj y de la salida Q de IC1a no pueden ocurrir nunca al mismo tiempo. Por tanto, los dos flip-flops nunca se disparan de forma simultanea, por lo que el modo de funcionamiento de este contador es asíncrono, cabe recalcar que la entrada de reloj de un contador asíncrono siempre esta conectado sólo al flip-flop LSB, osea al del bit menos significativo.


El flanco negativo de CLK (impulso de reloj 1) hace que la Salida Q de IC1a pase a nivel ALTO, como se muestra en la siguiente figura, al mismo tiempo la Salida Q de IC1a no afecta a IC1b ya que tiene que ser una transicion negativa la que lo dispare.

El flanco negativo del segundo impulso de CLK hace que Q de IC1a pase a nivel BAJO por lo tanto hace que Q de IC1b se ponga a nivel alto.

Ahora el flanco negativo de CLK hace que Q de IC1a pase a nivel ALTO nuevamente, por lo que no afecta el estado del segundo flip-flop, por tanto la salida Q de IC1b esta en nivel ALTO:

El cuarto impulso del reloj hace que el contador vuelva a su estado original por lo tanto los dos flip-flops se encuentran en estado RESET. El contador de 2 bits dispone de cuatro estados difrentes, como cabria esperar de dos flip-flops (2^2=4), ademas tenga en cuenta que si Q de IC1a representa el bit menos significativo (LSB) y Q de IC1b representa el bit mas significativo (MSB), la secuencia de los estados del contador representa una secuencia de numeros binarios como se muestra a continuacion:
Puesto que pasa por una secuencia binaria, el contador de la simulacion es un contador binario, en realidad cuenta el numero de impulsos de reloj hasta el tercero y, en el cuarto impulso inicia un nuevo ciclo a partir de su estado original (00). El inicio de un nuevo ciclo (recycle, termino que se aplica comunmente al funcionamiento de los contadores) se refiere a la transiscion del contador de su estado final a su estado original. En la logica digital Q de IC1a es siempre el bit menos signficativo LSB a menos que se indique lo contrario.Publicado por OptimusTronic en 10:12 11 comentarios
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Ruleta Digital

++ Descargar Diagrama ++
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Temporizador de Eventos Cortos

Los materiales a utilizar son los siguientes:

Para saber como construir el Modulo R+T revisar en el blog la sección de módulos. El voltaje para alimentar el circuito esta entre los 5 y 12 voltios.
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Artigos Relacionados:sábado, 6 de septiembre de 2008
Contadores: Empezando
vease Flip-flops: Teoria
Si les urge màs informacion sobre circuitos practicos entren a ForosDeElectronica, ahi encontraran bastante informacion, yo mas adelante tambien colocare practicas.
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Artigos Relacionados:jueves, 7 de agosto de 2008
555 Uno de los CI mas usados
555: Uno de los CI màs conocidos del mundo
Para todo estudiante, hobbista ó ingeniero Electrónico, sabe que el 555 es un circuito integrado bastante utilizado y conocido por todos ya que tiene cientos de aplicaciones, ahora vamos a explicar un poco sobre este dispositivo. El temporizador 555 es un dispositivo versátil y muy utilizado, porque puede ser configurado de dos modos distintos, bien como multivibrador monoestable o como multivibrador aestable (ósea como oscilador). Un multivibrador aestable no tiene estados estables y varia, por tanto, una y otra vez (oscila) entre dos estados inestables, sin utilizar un circuito de disparo externo.

Funcionamiento como monoestable
Tw=1.1*R1*C1

El capacitor C1 determina cuanto tiempo va a estar la salida a nivel alto
En este caso tw=1.1(2.2K)(0.01u)= 24.22us
La frecuencia de oscilación viene dada por la siguiente formula:
El ciclo de trabajo depende de los valores de R1 y R2 y puede ser ajustado seleccionando diferentes resistencias, dado que C1 se carga a través de R1 + R2 y se descarga únicamente a través de R2, se puede conseguir ciclos de trabajo de un mínimo del 50% aproximadamente, si R2>>R1, de forma que los tiempos de carga y descarga sean aproximadamente iguales.
La expresión para el ciclo de trabajo se obtiene de la manera siguiente. El intervalo de tiempo en que la salida esta a nivel ALTO representa lo que tarda c1 en cargarse desde 1/3Vcc hasta 2/3 Vcc. Por lo que el ciclo de trabajo esta dado por:
Ciclo de trabajo = [(R1+R2)/(R1+2R)]*100%
En el siguiente video pueden entender aun mas el funcionamiento del 555: (Gracias a Robo3001)
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Monoestable: Temporizador Secuencial.
Un monoestable, genera un único impulso cada vez que se dispara. Los dos tipos fundamentales de circuitos integrados monoestables son los redisparables y los no redisparables. Un monoestable no redisparable (74LS121) no responderá a ningún impulso de disparo adicional, desde el momento en que se pasa a su estado inestable hasta que retorna a su estado estable. En otras palabras, ignorara cualquier impulso de disparo que ocurra antes de que termine el periodo inestable. El tiempo que permanece el monoestable en su estado inestable es la anchura del impulso de salida. En este caso veremos la aplicación de un Monoestable Redisparable.
Sin ningún componente adicional se obtiene un impulso de unos 45ns de anchura, se pueden conseguir impulsos mas anchos mediante el uso de componentes externos. La formula general para calcular los valores de estos componentes para una determinada anchura del impulso (tw) es:
Si queremos una anchura de aprox. 1 segundo entonces, colocamos R=47Kohms, al realizar la operación y despeje queda C=66uF.
APLICACION
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Monoestables: Teoria
Para mas informacion: Wikipedia
Documento de Circuitos Monoestables, Gracias a Segio Noriega
Aplicaciones y Circuitos (Gracias a R-luis) Cerradura con Teclado electronico
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Artigos Relacionados:FLIP-FLOPS: Teoria
Dependiendo del tipo de dichas entradas los biestables se dividen en:
- Asíncronos: sólo tienen entradas de control. El más empleado es el biestable RS.
- Síncronos: además de las entradas de control posee una entrada de sincronismo o de reloj. Si las entradas de control dependen de la de sincronismo se denominan síncronas y en caso contrario asíncronas. Por lo general, las entradas de control asíncronas prevalecen sobre las síncronas.
La entrada de sincronismo puede ser activada por nivel (alto o bajo) o por flanco (de subida o de bajada). Dentro de los biestables síncronos activados por nivel están los tipos RS y D, y dentro de los activos por flancos los tipos JK, T y D. Para saber mas he investigado y encontre dos categorias para poder "comprender mucho mejor" este tema:
En las siguientes paginas, encontraran mas teoria e informacion respecto a los Flip-Flops, las cuales tienen animaciones en flash y de esa manera se entiende aún mejor:
Arquitectura del Computador: (Gracias al prof.Sandro Costantini)
Guia 10: Circuitos Secuenciales
Guia 11: Circuitos Secuenciales Sincronos
Guia 12: Flip Flops
Guia 13: Sumario de Flip Flops
Descargar archivos completos en pdf
Universidad Nacional de Colombia
Funcionamiento de un FLIP FLOP
Flip-Flop SR
Flip-flop JK Flip-flop JK 74LS76 Flip-flop D
Para mas informacion consulten:
Biestables (Gracias a R-luis)
Wikipedia
Wikipedia en Ingles
La practica y proyectos con flip-flops vendran mas adelante.
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LATCHES: Teoria y Practica
Latch RS
Los latchs a diferencia de los Flip-Flops no necesitan una señal de reloj para su funcionamiento.
El más simple latch lógico es el RS, donde R y S permanecen en estado 'reset' y 'set'. El latch es construido mediante la interconexión retroalimentada de puertas lógicas NOR (negativo OR), o bien de puertas lógicas NAND (aunque en este caso la tabla de verdad tiene salida en lógica negativa para evitar la incongruencia de los datos). El bit almacenado está presente en la salida marcada como Q.
Se pueden dar las siguientes combinaciones de entrada: set a 1 y reset a 0 (estado 'set'), en cuyo caso la salida Q pasa a valer 1; set a 0 y reset a 0 (estado 'hold'), que mantiene la salida que tuviera anteriormente el sistema; set a 0 y reset a 1 (estado 'reset'), en cuyo caso la salida Q pasa a valer 0; y finalmente set a 1 y reset a 1, que es un estado indeseado en los biestables de tipo RS, pues provoca oscilaciones que hacen imposible determinar el estado de salida Q.
Esta situación indeseada se soluciona con los biestables tipo JK, donde se añade un nivel más de retroalimentación al circuito, logrando que dicha entrada haga conmutar a las salidas, denominándose estado de 'toggle'.
para mas informacion:
Programa Universidad Virtual Colombia:
- Lección 1. Definición de la lógica secuencial
- Lección 2. Cerrojos con compuertas
- Lección 3. Estado metaestable
- Lección 4. Interruptor sin rebote
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Latches, Flip-Flops y Temporizadores
-
- LATCHES
74XX74 74XX279 74XX122 555 74121 74XX75 74XX112
más info:
Wikipedia
para ver un video tutorial:
Multivibradores, Gracias a Triac135
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Pulsador Antirrebote: Usando un Latch
El Latch Como Eliminador del Rebote de los Contactos
Una aplicación para un Latch S’-R’ consiste en la eliminación del “rebote” producido por los contactos de un interruptor mecánico. Cuando el polo de un interruptor choca con el contacto de cierre del interruptor, vibra o rebota varias veces hasta que, finalmente, se consigue un contacto firme. Aunque estos rebotes son mínimos, producen unos picos de tensión que pueden ser inadmisibles en un sistema digital. Como se muestra en las siguientes imágenes.
Típica Configuración utilizada
Rebote del contacto de un interruptor
Tensión transitoria errática debida al rebote de los contactos
En la “vida real” se tendrían rebotes aun mas pronunciados que en la simulación
SOLUCION
Se puede utilizar un Latch S’-R’ para eliminar los efectos de los rebotes del interruptor, como se muestra en las siguiente imagen:
El 74HC279 es un cuádruple match S’-R’ , por lo que serán 4 interruptores por integrado
El interruptor se encuentra normalmente en la posición 1, manteniendo la entrada R’ a nivel bajo y al match en estado RESET. Cuando el interruptor pasa a la posición 2, R’ pasa a nivel alto debido a la resistencia de pull-up conectada a Vcc y S’ pasa a nivel bajo cuando se produce el primer contacto. Aunque S’ permanece a nivel bajo durante un breve espacio de tiempo antes de que el interruptor rebote, este tiempo es suficiente para activar (SET) el latch. Cualquier otro pico de tensión aplicado posteriormente a la entrada S’, debido al rebote del interruptor, no va a afectar al latch, y este permanecerá en el estado SET. Téngase en cuenta que la salida Q del match proporciona una transición limpia del nivel bajo al nivel alto, por lo que se eliminan los picos de tensión causados por el rebote de los contactos. De forma similar se produce una transición limpia de nivel alto a nivel bajo cuando el interruptor vuelve a la posición 1.
Señal sin Rebotes
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Pulsador Antirrebote
El siguiente circuito evita este problema y solo utiliza un switch de un polo. Los demas componentes se encargan de lograr un retardo para ignorar esos rebotes indesesados. Más adelante incluire otros circuitos simples que seran de utilidad para esta misma utilidad.
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Contador Digital
Son circuitos digitales lógicos secuenciales de salida binaria o cuenta binaria, caracteristica de temporizacion y de memoria, por lo cual están constituidos a base de flip-flops.
Se utilizan para contar eventos. Ejemplos:
1. número de pulsos de reloj.
2. medir frecuencias.
3. Se utilizan como divisores de frecuencia y para almacenar datos. Ejemplo: en un reloj digital.
4. Se utilizan para direccionamiento secuencial y algunos circuitos aritméticos.
CONTADORES CON CI TTL
Son circuitos integrados donde vienen incluidos los flip-flops conectados según el tipo de contador y las puertas. Estos contadores se pueden llamar de propósito general. El CI 74192 es un contador reversible BCD síncrono TTL, es decir, módulo-10. Tiene doble entrada de reloj, una para cuenta ascendente y una para cuenta descendente que conmutan en la transición del nivel BAJO al nivel ALTO del pulso. La entrada de borrado síncrono se activa en nivel ALTO colocándo las salidas en nivel BAJO (0000) y se inicializa en cualquier número que se cargue en las entradas de datos en forma binaria y se transfieren asíncronamente a la salida BCD (A=QA, B=QB, C=QC, D=QD). La salida de arrastre se utiliza para conectar en cascada serie varios contadores.
en el foro se encuentra disponible la simulación en proteus de un contador digital de 0 a 9
Fuente: BlogElectronico
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Sensor de Toque
Celebrando mi entrada numero 100 les traigo este nuevo proyectito muy util:
Como pueden observar en el video de la simulacion; la parte central del circuito son las compuertas NAND por el circuito integrado 4011 también puedes utilizar su contraparte TTL 74LS00 en este caso utilicé el 4011.

Simulacion Realizada
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Circuito Electronico
Circuito en protoboard
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